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通过对比，发现原来是编译库路径发生改变导致的。为了解决这个问题，这里给出一种解决办法：即将工程下的modelsim.ini文件删掉就可继续仿真了。
05-04 15:27by
永不止步步 2460次查看
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在深入研究Nios自定制指令的软硬件接口的基础上，利用Matlab／DSP Builder建立快速傅里叶变换FFT核心运算指令基本模型，然后用Singacompiler工具进行编译，产生 Quart...
04-29 11:02by
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这里测试用的输入电源采用内阻低、放电电流大（一般大于100A）的12V汽车电瓶，可为电路提供充足的输入功率。测试用负载为普通的电灯泡。测试的方法是通过改变负载大小，并测量此时的输入电流、电压以及输出...
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在高速实时或者非实时信号处理系统当中，使用大容量存储器实现数据缓存是一个必不可少的环节，也是系统实现中的重点和难点之一
04-21 14:27by
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利用HFSS 提供的VBScript脚本功能，可以对软件进行二次开发，以VBScript作为接口，利用Matlab调用HFSS协同建模仿真，可以简化模型建立的操作，节约设计时间。
04-20 15:32by
宝啦宝呀 3121次查看
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单片机仿真器是指以调试单片机软件为目的而专门设计制作的一套专用的硬件装置。
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Protel99 SE的混合信号电路仿真引擎现在与3F5完全兼容，支持所有标准的SPICE模型。电路仿真支持包含模拟和数字元件的设计。SimCode（类C语言）用于描述数字元件的描述
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目前用户最需要是一个时序分析和SI结合一体工具，而且界面要优化，设置要简单，同时需要包括Design KIT。 时序问题是关键问题，目前设计者基本上采用核心芯片厂家现成方案，因此设计中主要一部分工作...
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PID调节器是逆变器中不可或缺的部分，PID调节器的好坏直接影响到逆变器的输出性能和带载能力。文中构建了10 KVA的单相SPWM逆变器的Simulink模型，负载采用纯阻性载和整流载分别进行仿...
04-15 09:43by
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基于抽取滤波器的工作原理，本文采用XC2V1000实现了一个抽取率为2、具有线性相位的3阶FIR抽取滤波器，利用原理图和VHDL共同完成源文件设计。控制器定时向加法器、乘法器和累加器发送数据或 ...
04-15 09:33by
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NC可用于数模混合仿真，即用verilog语言给画的电路图添加输入激励信号，然后查看输出信号，以验证电路是否正确。。
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最近仿真一段很奇怪的代码，testbench中分别使用#和@，但是输出波形不一致。
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单片机之DS18B20（用proteus）想用verilog驱动DS18B20。但是想到verilog调试比较困难，首先先用单片机来驱动看看。看看DS18B20是怎么驱动的。用proteus搭建软件...
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在cadence中，使用mos管和电阻构建了数字电路，但是要对这电路进行功能仿真，仿真的激励也比较复杂，不能使用简单的信号源产生，这个时候，就会考虑使用verilog，编写testbench来进行仿...
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说起来，玩FPGA也有个把年头了，但每次都是在quartus II里调用modelsim进行仿真的，为图个省事，一直都在忍受它带来的无比巨慢的编译连接速度。如今，实在是忍受不了，便狠了狠心，学习了一...
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看了好几天的书了，也没有实践下，今天下午休息，就在家把ADS捡起来弄弄。下面就以微带滤波器的设计为例。设计个三腔微带环形带通滤波器。
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下午在公司调试200MHz的LNA发现问题，增益33dB，频段220MHz，噪声大概在1.8左右。
一开始加电放大器就是自激，后来慢慢的调，自激现象消除，lna稳定，增益也达到要求，刚刚松口气，一...
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在做PCIE ip core仿真时，安装的modelsim se 10.0a在编译xilinx的unisims 一直提示can't determine language of ...
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