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学习计划【Allegro资源汇总帖】：http://www.eeskill.com/plan/id/ ...
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永不止步步 | 发表时间 2015-06-25
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本文探讨了如何使用相移时延技术来对主/从（Master/SlaVe）配置的多个DC/DC降压稳压器进 ...
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lotuse | 发表时间 2016-09-20
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最近几年电路板非常流行所谓的导线，然而这种不规则导线随着clock频率不断提高，设计人员也意识到必 ...
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露水非海 | 发表时间 2016-01-15
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州仔 | 发表时间 2014-05-13
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基础知识：Verilog 不可综合语句；建立可综合模型的原则。 ...
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永不止步步 | 发表时间 2015-06-09
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最近在看代码的时候，不小心发现了在表示变量位宽范围时用到了+:、-:这样的符号。这种用法还是第一次见 ...
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永不止步步 | 发表时间 2015-07-21
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以下是一个在设计中常犯的错误列表这些错误常使得你的设计不可靠或速度较慢为了提高你的设计性能和提高速度 ...
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编译指示(Pragma DirectiVes)可能是所有的预处理指令中最复杂的了，它的作用是设定编译 ...
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一帘幽梦飞 | 发表时间 2014-10-31
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近日，在德国Garching庆祝巴伐利亚科学院莱布尼兹超级计算中心（Leibniz-Rechenze ...
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州仔 | 发表时间 2014-03-18
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USB，是英文UniVersal Serial Bus（通用串行总线）的缩写，而其中文简称为通串线， ...
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Dabing | 发表时间 2015-01-31
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Verilog键盘扫描程序 ...
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娇 | 发表时间 2016-03-26
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FPGA共有四种配置模式：从串模式（SlaVe Serial(＄566.8500)），主串模式（Ma ...
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Dabing | 发表时间 2015-02-04
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我见过那种一个main函数写了1000多行的程序员，而且为数还不在少数。难道说他们不懂得用函数吗？不 ...
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期待 | 发表时间 2015-10-21
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本文基于嵌入式Linux平台的指纹门禁系统，该系统基于ARM9芯片Samsung S3C2440AL ...
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Dabing | 发表时间 2015-02-15
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最近学到了关于Verilog的阻塞赋值与非阻塞赋值的一些区别，经过网上查阅与仿真实验，有了一些理解。 ...
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期待 | 发表时间 2015-04-09
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本文介绍了WT6104CLVG无线基带芯片以及它在无线通信系统中的典型设计，采用该芯片设计的无线通信 ...
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lihong | 发表时间 2015-11-27
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参照ISO/IEC 18000-6 Type B 协议设计了一款工作频率为915 MHz的射频读卡器 ...
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露水非海 | 发表时间 2016-01-05
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本文介绍了基于VB 6.0的ActiVeX控件——Microsoft Communication通信 ...
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露水非海 | 发表时间 2015-12-18
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本文描述的是一种很常见的情况：当你在某个缓存中存储数据时，常常需要在运行时调整该缓存的大小，以便能容 ...
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小尚 | 发表时间 2016-01-18
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这段时间一直在看C++相关的数据结构，感觉STL库的出现确实给C++实现一些基本的数据结构更加的方便 ...
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期待 | 发表时间 2015-04-15
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