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为方便读者学习，本文小编给读者提供了用Verilog将二进制码转换为十进制BCD码的程序设计方法，供 ...
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YYJ | 发表时间 2015-05-29
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基于NI VeriStand和JMAG－RT进行高性能电机仿真 ...
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黑魔 | 发表时间 2014-03-13
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有些网友说conVert_hex2Ver.dll 文件无法找到，是因为目录不对，不是什么dll di ...
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期待 | 发表时间 2015-10-09
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本文提出了一种全数字差分BPSK扩频接收机的实现方案，通过Simulink仿真验证了该方案具有较低的 ...
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露水非海 | 发表时间 2015-12-11
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这几天复习了一下Verilog的语法知识，就借此写写我对这些东西的想法吧。感觉呢，是和C语言差不多， ...
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倩倩 | 发表时间 2014-07-12
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上次看了一下关于乘法器的Verilog代码，有几个地方一直很迷惑，相信很多初学者看这段代码一定跟我当 ...
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倩倩 | 发表时间 2014-07-12
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由于在网上和书上看到的流水线结构全是基于阻塞赋值的，结果输出是正确的（大部分时间），但是存在亚稳态的 ...
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一帘幽梦飞 | 发表时间 2014-10-14
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W5500EVB是WIZnet为了方便用户更好了解、使用W5500这款网络芯片所开发的评估板，该板采 ...
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凯瑞 | 发表时间 2015-05-12
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视觉系统，系统由CMOS图像传感器、CPLD、ARM7微处理器以及SRAM构成。其中，CPLD识别时 ...
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倩倩 | 发表时间 2014-06-23
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FPGA/CPLD器件的设计输入有很多种方式，如绘制原理图、编写代码或是调用IP核。早期的工程师对原 ...
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期待 | 发表时间 2015-05-04
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任务具有多个输入、输入/输出和输出变量，在任务重可以使用延迟、事件和时序控制结构，在任务重可以调用其 ...
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倩倩 | 发表时间 2014-07-12
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国际触控IC大厂Synaptics宣布以4.7亿美金收购面板驱动IC供货商Renesas SP Dr ...
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黑魔 | 发表时间 2014-06-14
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.设计必须文档化。要将设计思路，详细实现等写入文档，然后经过严格评审通过后才能进行下一步的工作。这样 ...
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hcay | 发表时间 2014-10-10
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在FPGA设计中，glbl.v常用来定义全局复位/置位、全局三态信号和DUT的连接，并且用来为设计提 ...
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期待 | 发表时间 2015-09-24
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：USB总线(UniVersal Setial Bus通用串行总线)是用来连接外围设备与计算机的新式 ...
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宝啦宝呀 | 发表时间 2015-05-07
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ADC，analog-to-digital conVersions，模数转换器，需要使用它的场合非常 ...
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一帘幽梦飞 | 发表时间 2014-10-11
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本文介绍了Verilog HDL的时序逻辑电路 ...
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畅学e | 发表时间 2015-05-14
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AD转换器相关名词解释 1)分辩率(Resolution) 指数字量变化一个最小量时模拟信号的变化量 ...
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lotuse | 发表时间 2016-10-14
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在很多地方都能看到，Verilog中if与case语句必须完整，即if要加上else,case后要加 ...
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永不止步步 | 发表时间 2015-06-10
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VHDL全名Very-High-Speed Integrated Circuit Hardware ...
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Dabing | 发表时间 2015-02-03
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