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。本文结合NCverilog，DesignCompile，Astro等ASIC设计所用到的EDA软件 ...
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晓晓nn | 发表时间 2016-11-28
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随着电子对抗技术的快速发展，在有源式干扰机中需要用到数字高斯白噪声。通过对混合同余法产生随机序列的原 ...
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本文验证了仿真两类HDL（VHDL和Verilog HDL）设计的ALTERA项目必须分开建立仿真库 ...
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永不止步步 | 发表时间 2015-10-16
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硬件描述语言Verilog为数字系统设计人员提供了一种在广泛抽象层次上描述数字系统的方式，同时，为计 ...
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A123 | 发表时间 2015-04-29
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HDL是一种硬件描述语言,用于从算法级、门级到开关级的多种抽象设计层次的数字系统建模。被建模的数字系 ...
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期待 | 发表时间 2015-05-25
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记得很久以前，用单片机玩数码管的时候，我们用“%”和“/”将一个长长的数字一一分离出来逐个显示在数码 ...
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永不止步步 | 发表时间 2015-06-11
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通用异步收发器UART常用于微机和外设之间的数据交换，针对UART的特点，提出了一种基于Verilo ...
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畅学e | 发表时间 2015-05-13
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文章给出了一种基于FPGA并利用Verilog HDL实现的CMI编码设计方法。研究了CMI码型的编 ...
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Verilog支持设计者从算法的角度，即从电路外部行为的角度对其进行描述，在这个层次上设计数字电 ...
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lotuse | 发表时间 2016-09-06
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本文将对时下流行的验证技术(形式验证、随机、定向、有约束的随机、断言、属性检验)与语言(System ...
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期待 | 发表时间 2015-05-25
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本文介绍了Cadence公司的NC-Verilog/Verilog-XL Simulator以及Si ...
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Dabing | 发表时间 2015-02-03
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VHDL和Verilog HDL是逻辑设计两种比较流行的硬件描述语言，业界一直没有停止对二者优劣的 ...
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永不止步步 | 发表时间 2016-02-23
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过去见过不少新手在这方面出错，而且查不出原因，感觉有必要给大家提个醒。
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Dabing | 发表时间 2015-02-04
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这几天复习了一下Verilog的语法知识，就借此写写我对这些东西的想法吧。感觉呢，是和C语言差不多， ...
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露水非海 | 发表时间 2016-05-18
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本文介绍了Verilog HDL高级语法结构―任务（TASK） ...
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畅学e | 发表时间 2015-05-14
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简述Verilog语法 ...
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莫北北 | 发表时间 2014-11-18
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本文介绍了射频控制模块中定时发送器" style="color:blue;text-decorati ...
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期待 | 发表时间 2015-05-23
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楼主这几个月都忙着调信号，除了放大就是滤波要么就是通信，当然时不时还会看高频，复习Verilog以及 ...
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永不止步步 | 发表时间 2015-10-29
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如果我们写测试文件（产生激励信号）时，不清楚应该个输入赋什么值的时候，这样写就是一个不错的选择。 ...
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永不止步步 | 发表时间 2015-06-09
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常用的信号类型有连线性（wire）、寄存器型（reg）、整形（integer）、实型（real）、时 ...
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期待 | 发表时间 2015-04-09
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