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casez,和casex是指除了正常的0,1电平外还包含高阻态(Z)和不确定信号(X)两种情况。在c ...
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16.6最新功能和PSpice设计流程综合 ...
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周立功Verilog HDL精华 ...
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Verilog HDL精简教程 ...
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C语言的嵌入式编程
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FPGA 协同设计 何宾 Xilinx
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实现AXI4中断控制系统 ...
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定制PWM IP,并添加IP到系统,编写应用程序 ...
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添加AXI4 IP到硬件设计 ...
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随着计算机普及率的提升以及软件行业的飞速发展,计算机语言也越来越受到广大计算机爱好者和计算机软件开发 ...
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3GPP(3rd Generation partnership pro ...
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AMBA规范概述、AMBA APB规范、AMBA AHB规范和AMBA AXI4规范。本章除了详细介 ...
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各种放大电路、信号处理电路、信号发生电路、电源电路等。 ...
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MATLAB信号处理仿真实验代码BA包
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Verilog
文档介绍:
数字电路设计是人类信息化浪潮的重要组成技术之一, ...
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系统概述:软核和硬核处理器,及片上可编程系统的发展背景、技术特点;设计方法:片上可编程系统设计流程、 ...
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针对数字图像处理与传输领域数据量大而传统接口无法满足其高速率传输要求的现状,提出了一种基于LVDS和 ...
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以基于ARM Cortex-M3内核的STM32F103C8T6作为主控 ...
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各种数字电路。包括时钟信号产生电路、波形整形及变换电路、定时与延时电路、计数分频及倍频电 ...
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FPGA(Field-Programmable Gate Array),即现场可编程门阵列,它是在P ...
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