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题外话:
总感觉&LDquo;年轻人”在字面上不准确,本人更喜欢用&LDquo;年青人”
同时又感觉&LDquo;青年人”的现实处境很诡异,...
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FPGA成长之路第一篇!
学习FPGA几个月以来 第一篇文章,我不擅长文字表达;就直奔主题了。
今天快下班闲来无事,在写一个点亮数码管的代码,手一抖,突然把编辑区...
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开发的一款液晶驱动器,接收MCU过来的指令和数据进行图像显示。使用了一片可编程(带使能和PWM调节控制)的背光芯片。在CPLD设计中,上电复位状态将背光使能拉低(关闭),直到MCU...
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在《都是IO弱上拉惹的祸》文中,提及了Altera的CPLD在初始化时管脚通常会处于弱上拉状态。在实际示波器采样来看,就表现在上电初期IO脚会有一个短暂(当时是持续大约几百us)的...
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昨晚,在用Quartus II对工程进行编译时,遇到了一个错误问题,足足让我想了10秒钟。如果是以前,一两秒就想到。看来是时间太长了,有点忘记了。说不定...
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今天做了一个实验,发现从Quartus II的Tools菜单下执行TCL脚本,如果TCL脚本里调用了其它TCL脚本,那么所有的TCL脚本就必须放在工程目录下,否则被调用的TCL脚本...
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最近在整SOPC,在xilinx的EDK开发环境中开发自己的IP,自己的IP中又要调用xilinx ISE中的一些IP,例如ram、rom、clock等,一直苦于不知道如何调用,找...
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FPGA使用的越来越广泛,除了可用于设计控制电路以为,数字信号处理电路更是FPGA的强项和难点。个人可以说才刚刚入门FPGA设计,也做过一些数字信号处理方面的电路设计,记录下个人心...
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Xilinx的FPGA设计有一套自己的开发工具——ISE。ISE功能强大,其中最重要一个就是它里面自带了大量的程序模板,使得设计人员不需要自己手动敲一些重复...
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上周没有定下任务,于是看看文档,累了就把尘封多时的altera的FPGA和CPLD拿出来玩玩。由于一直用的是xilinx的芯片,用的都是ISE或vivado,好久没用的quartu...
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问题:将Quartus软件从11.0升级到13.0sp1后发现代码的中文注释全变成乱码了
解决:用第三方的代码编辑软件将原先的程序文件保存成&LDquo;UTF-8 无BOM&r...
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板子上因为IO口不够用,采用了一个I2C转8路GPIO的芯片PCF8574(tssop20),控制Darlington管MC1413,驱动后端的7个Relay。
控制逻辑简图:
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最近有个FPGA+DSP架构的项目,安装了DSP的开发环境CCS,这里介绍下CCS的使用方法。说明:开发TMS320C6678,建议使用CCS5.0以上版本,以下介绍基于CCS5....
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问题如下:
我用DM642接FLASH芯片Am29LV033C用于BOOT,系统没有用FPGA。因为DM642地址线不够,考虑FLASH高三位地址用DSP的IO来扩,好像只有GP...
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ISP(In-System Programmable;在线编程)。ISP笼统的说就是在线编程,把单片机焊到电路板上,如果发现程序哪里有不合适的地方,可以直接通过pc进行编程,而不用...
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问题如下:
我用DM642接FLASH芯片Am29LV033C用于BOOT,系统没有用FPGA。因为DM642地址线不够,考虑FLASH高三位地址用DSP的IO来扩,好像只有GP...
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随着FPGA设计复杂程度越来越高,芯片内部逻辑分析功能显得越来越重要。硬件层次上的逻辑分析仪价格十分昂贵,而且操作比较复杂。目前,FPGA芯片的两大供应商都为自己的FPGA芯片提供...
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一:generateVerilog-2001添加了generate循环,允许产生module和primitive的多个实例化,同时也可以产生多个variable,net,task,...
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(一)Quartus警告解析 1.Found clock-sensitive change during activeclock edge at time<tim...
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Error: Specified license is not valid forthis machine
Quartus II 软件没有破解好,重新破解试...