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出于让PCB 焊接时尽可能不变形的目的，大部分PCB 生产厂家会要求PCB 设计者在PCB 的空旷区域填充铜皮或者网格状的地线。但是我们的工程师对这个“填充&rdquo...
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PCB上的任何一条走线在通过高频信号的情况下都会对该信号造成时延时，蛇形走线的主要作用是补偿“同一组相关”信号线中延时较小的部分，这些部分通常是没有或比其它...
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正片：自动生成热风，线宽为设定的最小线宽规则，移动元件需要更新覆铜优点：由于自动连接和避让，不易出错，有较全的DRC检查；缺点：避让和热风设置不灵活。<...
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很多朋友在工作过程中经常会碰到各种不同格式的PCB设计文件,本人总结了下文件后缀对应的格式,希望对大家能有帮助.
1）.pcb。最常见的后缀，很多PCB设计文件都是这一后缀，其中...
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模拟信号尤其是类似0～数十MHz video信号宽带电路时，电路图上详细标示信号的流动路径与组件位置非常重要。图1 是电流复归型video 用OP 增幅器HA-5020 构成的影像...
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在PCB抄板、PCB设计等过程中，由于不同软件平台之间的数据或文件格式不同，常常需要借助其他的工具进行平台或文件格式的转换，本文我们将为大家介绍从PROTEL到ALLEGRO的转换...
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PCB设计中层叠结构的设计建议：
1、PCB叠层方式推荐为Foil叠法
2、尽可能减少PP片和CORE型号及种类在同一层叠中的使用（每层介质不超过3张PP叠层）
3、两层之间...
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Allegro的菜单并不是固定不变的，用户可以自己添加、删除命令或者是更换顺序。
在D:\Cadence\SPB_16.5\share\pcb\text\cuimenus 目录下...
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吸取了上次制板的经验教训，新版本的DM8168又出炉了。。。
第一层：电源、DM8168、DDR3、FPGA、CPLD、Nandflash、USB、以太网、SATA、JTAG等。...
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版本：Cadence SPB16.5
Design Entry CIS 中的 OrCAD Capture CIS 一直都能正常使用
但是有一次打开，卡住进不了主界面...
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使用Capture CIS 生成网表时，出现错误：
Unable to open ...\tools\capture\allegro.cfg for reading. Pleas...
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使用Allegro时修改shape的网络节点方法：
①选择shape->Select Shape or Void/Cavity
②选择要修改的shape
③点击（....
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使用Allegro时需要批量复制net属性是GND或是其它属性的Via：
批量选中Via后点击Copy或'Shift+F5'
然后完成复制，如图：
复制完，我们可能发现，...
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以前一直用protel很多年，也没觉得那里不好。但因工作原因，接触越来越多画图软件，自然就有了对比。下面是些心得，希望对象我一样的“懒人”有用，以下属个人观...
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在调试设备过程中遇到一个问题，现象是在单独测试测量单元时，测量数据的精度完全能够满足要求，而将测量单元与设备整体进行连接后，测量值就开始上下跳动，跳动范围已经远远超出了可接受范围。...
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1、首先养成良好的习惯，拿到新的板子，在焊接PCB线路板前要目视一遍PCB板，并用万用表检查关键电路（特别是电源与地的部分）是否短路。
2、首先焊接一些小的元器件， 如电阻、电容...
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硬件测试过程：
1、首先断电情况下测量是否有短路发生，可以测电源正负极，以及极性电容两端是否有短路。
2、没有短路的情况下，可以上电了，测试器件的vcc和gnd...
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PCB直角走线问题讲解
直角走线一般是PCB布线中要求尽量避免的情况，也几乎成为衡量布线好坏的标准之一，那么直角走线究竟会对...
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在PCB设计中，布线是完成产品设计的重要步骤，可以说前面的准备工作都是为它而做的， 在整个PCB中，以布线的设计过程限定最高，...
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1、阻抗匹配
阻抗匹配是指信号源或者传输线跟负载之间的一种合适的搭配方式。根据接入方式阻抗匹配有串行和并行两种方式；根据信号...
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