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[ 视频 ] 《基于VHDL的FPGA与NIOS II实例精炼》第三章

VHDL的数据对象

by zsss|创建时间 2016-08-29 |768查看
[ 视频 ] 至芯科技FPGA视频教程之时序逻辑设计要点

本讲总结了时序逻辑设计要点。

by 永不止步步|创建时间 2013-11-15 |767查看
[ 视频 ] 同济大学FPGA/VHDL教学视频23

同济大学

by 永不止步步|创建时间 2014-03-05 |763查看
[ 视频 ] Lesson08：简单的Testbench设计—专辑：《深入浅出玩转FPGA》

简单的Testbench设计，特权主讲

by 永不止步步|创建时间 2013-11-25 |763查看
[ 视频 ] 基于FPGA出租车计费器设计

本视频主要讲了一下基于FPGA出租车计费器设计。

by 晓晓nn|创建时间 2016-10-27 |759查看
[ 视频 ] 同济大学FPGA/VHDL教学视频29

同济大学

by 永不止步步|创建时间 2014-03-05 |759查看
[ 视频 ] 至芯科技FPGA视频教程之全局时钟网和平衡树结构

本讲主要讲解了全局时钟网和平衡树结构。

by 永不止步步|创建时间 2013-11-17 |759查看
[ 视频 ] HELLO FPGA之项目实站篇 02

_软件工具知识复习

by zsss|创建时间 2016-09-28 |752查看
[ 视频 ] 至芯科技FPGA视频教程之RAM的verilog模块

RAM的verilog模块

by 永不止步步|创建时间 2013-12-02 |747查看
[ 视频 ] 明德扬FPGA系列之signaltapII 10

10signaltap练习4答案

by lotuse|创建时间 2016-09-21 |741查看
[ 视频 ] HELLO FPGA之项目实站篇 09

按键外设进阶

by zsss|创建时间 2016-09-28 |738查看
[ 视频 ] 零基础学FPGA之Verilog HDL

零基础学FPGA

by lotuse|创建时间 2016-09-21 |736查看
[ 视频 ] 至芯科技FPGA视频教程之verilog设计举例（3）

verilog设计举例

by 永不止步步|创建时间 2013-12-02 |736查看
[ 视频 ] 同济大学FPGA/VHDL教学视频32

同济大学

by 永不止步步|创建时间 2014-03-05 |733查看
[ 视频 ] 同济大学FPGA/VHDL教学视频18

同济大学

by 永不止步步|创建时间 2014-03-05 |731查看
[ 视频 ] HELLO FPGA之项目实站篇 07

_时序电路知识复习

by zsss|创建时间 2016-09-28 |730查看
[ 视频 ] 同济大学FPGA/VHDL教学视频16

同济大学

by 永不止步步|创建时间 2014-03-05 |730查看
[ 视频 ] HELLO FPGA之数字电路篇 02

02_组合逻辑电路1

by zsss|创建时间 2016-09-28 |729查看
[ 视频 ] 同济大学FPGA/VHDL教学视频14

同济大学

by 永不止步步|创建时间 2014-03-05 |729查看
[ 视频 ] HELLO FPGA之项目实站篇 01

组合逻辑电路知识复习

by zsss|创建时间 2016-09-28 |728查看

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