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使用QUARTUSII生成Testbench，然后打开Modelsim软件，进行单独仿真。 ...
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永不止步步 | 发表时间 2015-06-12
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直接序列扩频通信系统以强抗噪声、低截获性和多址通信等特点，在军事及民用移动通信网络中得到广泛应用。文 ...
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露水非海 | 发表时间 2016-01-05
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软件使用版本：QUARTUS II 13.0+Modelsim_Altera10.1d
工程使用例 ...
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永不止步步 | 发表时间 2015-06-11
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altera的programmer的脚本命令，即QUARTUS_pgm，和我们在虚拟JTAG里面使用 ...
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永不止步步 | 发表时间 2016-02-23
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以CPLD器件EPM7128SLC84—6为核心的电器定时开关控制系统设计实现24小时制时钟功能，可 ...
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本系统使用Nios嵌入式系统在单芯片内实现了数据处理、存储访问、数据模式转换等多个功能。采用Alte ...
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永不止步步 | 发表时间 2014-06-19
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对二维信号实时处理涉及大量的复数运算且对运算速度要求很高，因此二维有限长单位脉冲响应滤波器(2D—F ...
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郭秀斌 | 发表时间 2014-05-19
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本设计首先用硬件描述语言（VHDL）进行DES（数据加密标准）、3DES（三重DES）算法编码和系统 ...
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畅学e | 发表时间 2015-04-16
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以QUARTUS为例（延时数据为Stratix III器件典型延时）手动布局：module top( ...
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永不止步步 | 发表时间 2015-10-29
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通过对TCDl50lD输出图像信号特征的简要分析，分别阐述了内、外2种除噪方法，并给出了相应的时序， ...
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宝啦宝呀 | 发表时间 2015-05-11
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针对谐波污染问题，设计并实现了一种由上、下位机组成的并联型有源电力滤波器。以TMS320C5416 ...
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倩倩 | 发表时间 2014-06-23
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本文主要介绍QUARTUS生成IP核的仿真出错问题的解决办法，感兴趣的朋友可以看看。 ...
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以CPLD为逻辑控制核心实现了ADS8323与高速FIFO的接口电路,该电路具有可靠性高、通用性强、 ...
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本文以现场可编程逻辑器件(FPGA)为设计载体，以硬件描述语言(VHDL)为主要表达方式，以Quar ...
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微笑眼泪 | 发表时间 2015-07-29
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脑电信号的数字处理以往采用通用PC机或单片机实现，存在实时性差等缺点。随之，基于FPGA的小波变换在 ...
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倩倩 | 发表时间 2014-07-02
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随着电子对抗技术的快速发展，在有源式干扰机中需要用到数字高斯白噪声。通过对混合同余法产生随机序列的原 ...
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显示路径延时在以前老的QUARTUS II版本里不是问题，只是当Altera更新了新的版本之后（具体 ...
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娇 | 发表时间 2016-03-26
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基于FPGA 的电机测速系统设计，以QUARTUS II 为设计平台，采用硬件描述语言VHDL和模块 ...
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hcay | 发表时间 2015-02-05
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2004年，Altera 正式推出了Nios II系列32位RISC嵌入式处理器。Nios II系列 ...
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Dabing | 发表时间 2015-02-04
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在数字视频采集与处理板级系统开发的基础上，本文提出了采用 SoPC实现运动视觉处理与控制系统的设计方 ...
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畅学e | 发表时间 2015-05-16
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