从这个模块要实现的功能说起吧,如图1所示,实现的功能其实很简单的,就是一个频率计,只不过FPGA除了脉冲采集进行计数外,还要响应CPU的控制。图1 功能模块
来自
FPGA|by
银火虫 |发表时间 2016-06-13
|0个回复
FPGA/CPLD能做什么呢?
可以毫不夸张的讲,FPGA/CPLD能完成任何数字器件的功能,上至高性能CPU,下至简单的74电路,都可以用FPGA/CPLD来实现。
FPGA...
来自
FPGA|by
银火虫 |发表时间 2016-06-17
|0个回复
0 引言
在数字系统的设计中,FPGA+ARM 的系统架构得到了越来越广泛的应用,FPGA 主要实现高速数据的处理;ARM 主...
来自
FPGA|by
银火虫 |发表时间 2016-06-18
|0个回复
上图是我的系统结构,FPGA使用AD产生的120M差分时钟作为时钟,通过一个DCM生成120M,240M的时钟,使用DCM生成的时钟作为AD采样时钟来采样并行14bit差分数据...
FPGA、ASIC和ASSP
抛开FPGA不提,大家一定都很熟悉ASIC与ASSP。所谓ASIC,即专用集成电路(Application Specific Integrated ...
一.在quartus中新建工程后,点击工具栏里的Tools,在下拉菜单中选取Options,弹出对话框,在对话框里选择EDA Tool Options,然后在右侧的Modelsim...
一、关于多采样率数字滤波器
很明显从字面意思上可以理解,多采样率嘛,就是有多个采样率呗。前面所说的FIR,IIR滤波器都是只有一个采样频率,是固定不变的采样率,然而有些情况下需要...
两个输入管脚分别输入了一个时钟信号,而且两个信号是反相的。输出之后应该是输出端s位高电平,co为低电平才对的,但是输出出现了一些峰刺还是什么的。用功能仿真就没有这个问题。请大家帮忙...
学习PCIE也有两个月了,经过多次的失败,总算是实现了 xapp1052 和 xapp1030 里面的演示,但是我却
从大学时代第一次接触FPGA至今已有10多年的时间,至今记得当初第一次在EDA实验平台上完成数字秒表、抢答器、密码锁等实验时那个兴奋劲。当时由于没有接触到HDL硬件描述语言,设计都...
关于阻塞:计算RHS并更新LHS,此时不能允许有来自任何其他Verilog语句的干扰。 所谓阻塞的概念是指在同一个always块中,其后面的赋值语句从概念上(即使不设定延迟)是在前...
我们所说的FPGA配置电路,一方面要完成从PC上把bit文件下载到FPGA或存储器的任务,另一方面则要完成FPGA上电启动时加载配置数据的任务。在开始设计FPGA的配置电路之前,我...
看到一片关于AD转换设计中的基本问题整理博文,特地转载过来和大家共分享。
了解数据转换器错误及参数
1.如何选择高速模数转换之前的信号调理器件;如何解决多路模数转换的同步问题?...