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当今复杂的FPGA含有众多用于实现各种电路与系统的功能块，诸如逻辑阵列、存储器、DSP 模块、处理器 ...
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露水非海 | 发表时间 2016-05-07
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本文在CycloneⅢFPGA中实现异步FIFO和锁相环(PLL)结构的设计，避免复杂的时钟管理，简 ...
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YYJ | 发表时间 2015-05-15
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本文主要介绍的是RC时钟信号产生电路 ...
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hcay | 发表时间 2015-02-15
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网络服务供应商正以令人瞩目的速度扩充其传输网络容量，来满足对带宽敏感的视频和网络多媒体应用的快速增长 ...
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一帘幽梦飞 | 发表时间 2014-09-28
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I2C 工作速率有100K和400K两种；
支持多机通讯；
支持多主控模块 ...
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郭秀斌 | 发表时间 2014-05-21
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· 高速数字电路（即高时钟频率及快速边沿）的设计成为主流。
· 产品小型化及高性能必须面对在同一块 ...
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凯瑞 | 发表时间 2015-04-16
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LCD的接口时序波形如图所示。VSYNC是场同步信号，低电平有效，从时序图可以看出，VSYNC是 ...
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lotuse | 发表时间 2016-09-26
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上面一篇给出了MSP430时钟系统的大体框架。下面我们将具体看一下每个时钟模块的内部结构，看一下他们 ...
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冯大同 | 发表时间 2013-12-13
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当产生门控时钟的组合逻辑超过一级时，证设计项目的可靠性变得很困难。即使样机或仿真结果没有显示出静态险 ...
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粽子糖果 | 发表时间 2017-01-17
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本文采用该系统对不同标准频率进行测试后，得到该系统的频率测量准确度：±0.15 PPM,日误差 ...
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Dabing | 发表时间 2015-02-16
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LPC2141/2142/2144/2146/2148是基于一个支持实时仿真和嵌入式跟踪的32/16 ...
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王者风范 | 发表时间 2015-11-09
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本文为大家提供一个基于AVR单片机实现电子时钟设计。 ...
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目前，大型设计一般推荐使用同步时序电路。同步时序电路基于时钟触发沿设计，对时钟的周期、占空比、延时和 ...
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CPU时钟频率在过去5年里没有增加是很多不同类别的原因导致的。当设计一个CPU的微架构时，其中一个关 ...
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本文介绍了射频控制模块中定时发送器" style="color:blue;text-decorati ...
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期待 | 发表时间 2015-05-23
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基于FPGA的时钟设计 ...
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黑魔 | 发表时间 2014-03-15
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本实例使用Quartus II中用于例化IP核的Megafunction配置一个PLL模块，PL ...
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lotuse | 发表时间 2016-09-18
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OmniClock系列支持从8 kHz到200 MHz的任意输出频率，有三个单 ...
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粽子糖果 | 发表时间 2017-06-06
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本文回答了关于零漂移运算放大器的一些问题，其中有：什么是零漂移放大器？零漂移放大器适合哪些应用？自稳 ...
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宝啦宝呀 | 发表时间 2015-04-23
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一般正常运行时，我们使用的时HSE（外部高速时钟源），当准备进入低功耗时，我们会切换到内部高速时钟H ...
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王者风范 | 发表时间 2015-12-17
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